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HDMI转EDP芯片NCS8803简介

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发表于 2017-8-29 10:16:42 | 显示全部楼层 |阅读模式
NCS8803 HDMI-to-eDP w/ Scaler
8 f+ y: N7 K: ]6 D$ R
0 ]7 N& w- X8 F" v9 `$ D" ?
Features
--Embedded-DisplayPort (eDP) Output
3 F6 H8 G! _5 C: c1 t) Y
- r$ q  h  d/ A1 e
1/2/4-lane eDP @ 1.62/2.7Gbps per lane
HD to WQXGA (2560*1600) supported
Up to 6dB pre-emphasis

0 t# L$ M6 y. c- C/ V
--HDMI Input
HDMI 1.4a supported
RGB444/YCbCr444/YCbCr422 supported
Pixel clock up to 340MHz
2-channel audio supported
Adaptive equalization

6 c6 F- m+ T0 c% p& F7 H% D- f/ \; c/ R
--Reference Clock
Any freq. between 19MHz and 100MHz
Crystal or single-ended clock input
Built-in 5000ppm SSC generator

, w. P. Q3 T7 @. X, k
--Misc
I2C for chip configuration
Built-in eDP handshake protocol
I2C-AUX channel for TCON/DPCD/EDID
control
Built-in video test pattern
: A) y) h- n! g& v2 E* O
--Power
1.2V core supply
2.5V or 3.3V IO supply
Power consumption ~ 150mW
@ 2560*1600*24bit*60Hz
Deep-sleep mode power <1mW
6 ]) \3 P; W0 [; {( W* m. _
--Package
QFN-56 (7mm x 7mm) package
RoHS Compliant

, }$ d+ h7 x0 A+ U) s! X) D
--Availability
Samples by the end of 2016
: F6 A" n6 C: h* g+ u
6 n; r) Q5 E, F/ U7 [3 N
4 @* r% w! \4 o! y3 j+ |
Block Diagram
% K/ ]' s) b1 f/ ?7 m4 j
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