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HDMI转EDP芯片NCS8803简介

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发表于 2017-8-29 10:16:42 | 显示全部楼层 |阅读模式
NCS8803 HDMI-to-eDP w/ Scaler
/ b9 t. I7 E8 i* @# ^; d8 P2 {+ y: A2 L; m. u" X
Features
--Embedded-DisplayPort (eDP) Output
9 W5 k# Q' |" m' A  q
& A# L: B$ J. t$ H
1/2/4-lane eDP @ 1.62/2.7Gbps per lane
HD to WQXGA (2560*1600) supported
Up to 6dB pre-emphasis
1 ^+ \( Z. [# \+ q
--HDMI Input
HDMI 1.4a supported
RGB444/YCbCr444/YCbCr422 supported
Pixel clock up to 340MHz
2-channel audio supported
Adaptive equalization
8 C6 b, E5 K& G6 W2 g% K( B" G
--Reference Clock
Any freq. between 19MHz and 100MHz
Crystal or single-ended clock input
Built-in 5000ppm SSC generator
, k: Z; C7 o, l' \# z/ O
--Misc
I2C for chip configuration
Built-in eDP handshake protocol
I2C-AUX channel for TCON/DPCD/EDID
control
Built-in video test pattern

; C6 X# U1 @, q6 b8 h' l
--Power
1.2V core supply
2.5V or 3.3V IO supply
Power consumption ~ 150mW
@ 2560*1600*24bit*60Hz
Deep-sleep mode power <1mW

0 W# t6 a( s' u- d
--Package
QFN-56 (7mm x 7mm) package
RoHS Compliant
7 q' M, J3 e3 U8 R& X2 _! |
--Availability
Samples by the end of 2016

1 V7 K8 I) c. L
6 Q2 i- T% H7 G$ T5 o, P! a& O* e1 }6 }, D0 y' k8 Z
Block Diagram
  a% D, h5 V- R+ r* i; E3 B. w
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